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探讨了一种基于SystemC的RISC CPU建模方法，建立了一个SPARC精简指令集CPU的整数单元(IU)行为级模型．该模型作为指令集仿真器(ISS)．基本达到了RISC CPU的功能要求．为程序提供了一个CPU模拟平台．减少了软硬件协同设计的周期，这对片上系统SOC的实现具有重要的意义。
基于SystemC的RISC CPU行为描述
【摘 要】
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探讨了一种基于SystemC的RISC CPU建模方法，建立了一个SPARC精简指令集CPU的整数单元(IU)行为级模型．该模型作为指令集仿真器(ISS)．基本达到了RISC CPU的功能要求．为程序提供了一
【机 构】
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厦门大学计算机与信息工程学院,厦门大学电子工程系．福建厦门361005
【出 处】
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厦门大学学报(自然科学版)
【发表日期】
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2004年1期
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