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本文基于14bit的ADC设计,提出了一种冗余位为2bit的算法,相比于传统的方法,它提高了输入动态范围,大大降低了对比较器的要求,从而有效的解决了因为比较器的偏差带来的SFDR的下降.对采用本文算法设计的ADC电路进行了仿真,有效位数达到了13.7bit,并且具有较低的功耗.
一种用于高精度模数转换器的数字校正算法
【摘 要】
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本文基于14bit的ADC设计,提出了一种冗余位为2bit的算法,相比于传统的方法,它提高了输入动态范围,大大降低了对比较器的要求,从而有效的解决了因为比较器的偏差带来的SFDR的
【机 构】
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中国电子科技集团公司第五十四研究所
【出 处】
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中国集成电路
【发表日期】
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2014年12期
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