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本文设计了一种以FPGA为数据缓冲和逻辑控制单元的高速数据采集系统，提出了数据缓冲模块的两种不同实现方法，用以实现数据采集模块与数据处理模块之间的高速连接。通过软件仿真，详细分析了这两种方法的特性及其各自的适用场合。
一种基于FPGA的高速数据缓存的设计
【摘 要】
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本文设计了一种以FPGA为数据缓冲和逻辑控制单元的高速数据采集系统，提出了数据缓冲模块的两种不同实现方法，用以实现数据采集模块与数据处理模块之间的高速连接。通过软件仿真
【机 构】
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西安电子科技大学宽禁带半导体材料与器件教育部重点实验室
【出 处】
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微计算机信息
【发表日期】
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2008年32期
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