【摘 要】
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为了满足对高速串行数据长时间实时显示存储的要求,提出了一种采用FPGA＋ARM作为主控制器结合大容量Flash缓冲的设计方案;系统前端采用FPGA串并转换并控制Flash进行数据采集,后
【机 构】
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中北大学电子测试国家重点实验室,中北大学仪器科学与动态测试教育部重点实验室
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为了满足对高速串行数据长时间实时显示存储的要求,提出了一种采用FPGA＋ARM作为主控制器结合大容量Flash缓冲的设计方案;系统前端采用FPGA串并转换并控制Flash进行数据采集,后端采用ARM进行实时显示存储;该系统采集速率高,能够采集高达8.45Mbps的输入数据,存储容量可扩;系统是针对两路输入速度高达460800 bps的串行数据而设计的,经测试验证,数据存储可靠稳定,可广泛应用于飞行装置上.
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