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提出了一种支持高性能可复用微控制器芯核的体系结构的多路总线及接口，解决了片上外设与微控制器CPU之间的扩展和匹配问题，使得芯核内部互联网络简化，时钟率提高，实现了高性能微控制器的可复用性设计。
一种提高微控制器IP可复用性的核内总线设计
【摘 要】
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提出了一种支持高性能可复用微控制器芯核的体系结构的多路总线及接口，解决了片上外设与微控制器CPU之间的扩展和匹配问题，使得芯核内部互联网络简化，时钟率提高，实现了高性能微
【机 构】
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华中科技大学图像识别与人工智能研究所图像处理与智能控制国家重点实验室
【出 处】
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计算机工程与应用
【发表日期】
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2005年2期
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