基于FPGA的通用RS编解码器的VHDL设计方法

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利用VHDL中的枚举和函数重载功能定义伽罗华域中的各种“+”,“-”,“×”,“÷”运算,并且自定义了BCH解码中用到的函数和数据结构,使得编写的程序更加接近理论上对RS码的描述,从而增加可读性,并且在程序调试时减少了工作量,提高了效率。仿真结果表明该方法具有容易实现的特点。
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