FPGA中FIR数字滤波器设计可采用的一种成倍减少硬件资源使用的方法

来源 :四川理工学院学报(自然科学版) | 被引量 : 0次 | 上传用户：alucardlr

【摘要】

：

文章提出了一种新的FIR数字滤波器硬件实现结构.这种实现结构,大大减少了乘法器以及累加器等硬件资源的使用.文章对比讨论了两种FIR数字滤波器硬件实现结构所占用硬件资源的

【作者】

：

闫海刚陈俊

【机构】

：

电子科技大学电子工程系

【出处】

：

四川理工学院学报(自然科学版)

【发表日期】

：

2005年1期

【关键词】

：

滤波器设计资源使用 FPGA FIR数字滤波器硬件实现 MATLAB 硬件资源 EDA工具结构累加器乘法器文章 FIR digital filter

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文章提出了一种新的FIR数字滤波器硬件实现结构.这种实现结构,大大减少了乘法器以及累加器等硬件资源的使用.文章对比讨论了两种FIR数字滤波器硬件实现结构所占用硬件资源的差别,指出了新结构的优势;通过MATLAB及EDA工具的仿真,表明在完成FIR数字滤波方面,新的硬件实现结构的功能与传统结构是相同的.

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