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浮点加减运算是现代数字信号处理应用中非常频繁的操作，介绍了字长为20位的TI DSP浮点数在VirtexTM-E系列FPGA上的实现，这种设计在用三拍实现浮点加减运算时，速度达到了80M以上。
FPGA上浮点加／减法器的设计
【摘 要】
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浮点加减运算是现代数字信号处理应用中非常频繁的操作，介绍了字长为20位的TI DSP浮点数在VirtexTM-E系列FPGA上的实现，这种设计在用三拍实现浮点加减运算时，速度达到了80M以上
【机 构】
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西安微电子技术研究所
【出 处】
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计算机工程与应用
【发表日期】
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2003年2期
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