【摘 要】
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论述了UMC65nm CMOS工艺实现的全定制全数字锁相环.该锁相环用于提供高速嵌入式SRAM内建自测试所需的时钟.分析了全数字锁相环的工作原理和电路架构,并给出了整个锁相环系统
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论述了UMC65nm CMOS工艺实现的全定制全数字锁相环.该锁相环用于提供高速嵌入式SRAM内建自测试所需的时钟.分析了全数字锁相环的工作原理和电路架构,并给出了整个锁相环系统的电路和版图实现.编码控制振荡器是全数字锁相环中的核心电路,提出了一种改进的编码控制振荡器,具有高线性度和高精度的特点.在理论上分析了全数字锁相环系统的稳定性,并给出所采用的锁相环架构的稳定性公式.该锁相环达最高输出频率为2GHz,抖动小于1%.
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