【摘 要】
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浮点融合乘加部件会增加独立浮点加减法、乘法等运算延迟。为克服该缺陷，研究将乘加部件独立乘法、加减法等运算延迟由6拍减为4拍时对浮点性能的影响。以某支持乘加运算的国产
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浮点融合乘加部件会增加独立浮点加减法、乘法等运算延迟。为克服该缺陷，研究将乘加部件独立乘法、加减法等运算延迟由6拍减为4拍时对浮点性能的影响。以某支持乘加运算的国产处理器为基础，修改相关的RTL级设计代码，利用硬件仿真加速器平台，对SPECCPU2000浮点测试课题进行评估。实验结果表明，该延迟优化有利于提高浮点性能，最大提高5．25％，平均提高1．61％。
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