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在用HDL设计时,理解综合工具如何解释不同的HDL代码风格和预期结果是非常重要的.设计人员的代码风格会影响逻辑的利用率和时限性能.本文讨论一些基本的设计技术,确保FPGA最佳的综合结果,同时避免一些不可靠和不稳定的因素.设计人员应当认真设计组合逻辑以避免潜在的问题,同时应注意时钟方案保证同步功能.