【摘 要】
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针对电力系统传统IRIG-B码编码设备体积大、结构复杂等问题,提出一种基于FPGA的IRIG-B码信号产生器的设计方法：首先阐述方法的设计思想;然后重点描述其FPGA硬件电路设计与Nios
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针对电力系统传统IRIG-B码编码设备体积大、结构复杂等问题,提出一种基于FPGA的IRIG-B码信号产生器的设计方法：首先阐述方法的设计思想;然后重点描述其FPGA硬件电路设计与NiosII软件编程过程。试验结果表明,通过该方法设计IRIG-B码信号产生器可有效缩小设备体积、增强系统稳定性。该设计已应用到了工信部电子信息产业发展，
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