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给出了一种OBS边缘节点总线控制的硬件设计方案。该方案采用循环四次握手的方式完成主模块与其它从模块的通信，用轮询的方式把几个可能引起时序上冲突的信号，按顺序分配到不同的时钟周期上。整个方案以FPGA芯片EP2C20F484C8为基础实现，在QuanusⅡ软件上编译通过。仿真结果显示：该方案不仅能够解决时序冲突的问题，而且最高工作频率达到340MHz，在整个控制模块中占用的逻辑单元（LE）数目仅为0．9％。