【摘 要】
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该文介绍一种用高速数字信号处理器TMS320C25实现的码率由R=1/2变为R=3/4的可变码率软判决Viterbi译码器,该译码器的码型选为约束长度K=7的标准(2,1,6)卷积码,其硬件很简单,
【机 构】
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西安电子科技大学信息工程系,西安电子科技大学信息工程系,西安电子科技大学信息工程系,
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该文介绍一种用高速数字信号处理器TMS320C25实现的码率由R=1/2变为R=3/4的可变码率软判决Viterbi译码器,该译码器的码型选为约束长度K=7的标准(2,1,6)卷积码,其硬件很简单,系统成本低,信息译码速率达7kb/s;对其软件稍加修改,便可得到其它高码率的可变码率软判决Viterbi译码器。
This paper introduces a variable bit rate Viterbi decoder with bit rate from R = 1/2 to R = 3/4, which is realized by high speed digital signal processor TMS320C25. The code pattern of this decoder is selected as The standard (2, 1, 6) convolutional codes with constraint length K = 7 have simple hardware and low system cost, and the information decoding rate is up to 7kb / s. Other software rates can be obtained by slightly modifying the software Variable Bitrate Soft Decision Viterbi Decoder.
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