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提出了一种利用FPGA来实现的E1时钟恢复方案。根据E1数据帧的特点，设计了FPGA内部的数字锁相环。通过对传统数字锁相环的鉴相器进行改进，设计基于FIFO的积分型采样鉴相器。进行了误码测试和输入口允许频偏测试，测试结果表明恢复出的E1信号满足相关标准要求。
基于FPGA的E1时钟恢复方案的设计和实现
【摘 要】
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提出了一种利用FPGA来实现的E1时钟恢复方案。根据E1数据帧的特点，设计了FPGA内部的数字锁相环。通过对传统数字锁相环的鉴相器进行改进，设计基于FIFO的积分型采样鉴相器。进行
【机 构】
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中国电子科技集团公司第三十四研究所
【出 处】
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光通信技术
【发表日期】
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2016年7期
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