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本文采用VHDL语言,运用自顶向下(Top To Down)的方法,使用Isp Expert集成开发环境进行编辑、综合、波形仿真,并下载到CPLD器件中,设计并实现了8位数字频率计.
一种基于VHDL语言数字频率计的设计与实现
【摘 要】
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本文采用VHDL语言,运用自顶向下(Top To Down)的方法,使用Isp Expert集成开发环境进行编辑、综合、波形仿真,并下载到CPLD器件中,设计并实现了8位数字频率计.
【机 构】
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西南交通大学电气工程学院
【出 处】
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电子设计应用
【发表日期】
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2003年7期
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