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用FPGA对锁相环频率合成器加载的设计
用FPGA对锁相环频率合成器加载的设计
来源 :电子工程师 | 被引量 : 0次 | 上传用户:huoxingtan22
【摘 要】
:
介绍了利用FPGA对芯片MC145193写控制字从而实现对140 MHz锁相环加载的具体设计实现过程,并给出了最终的FPGA仿真波形.
【作 者】
:
何艳
陈国强
【机 构】
:
国防科技大学电子科学与工程学院
【出 处】
:
电子工程师
【发表日期】
:
2003年7期
【关键词】
:
FPGA
锁相环
频率合成器
MCl45193
控制字
FPGA
PhaseLocked Loop (PLL)
control word
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介绍了利用FPGA对芯片MC145193写控制字从而实现对140 MHz锁相环加载的具体设计实现过程,并给出了最终的FPGA仿真波形.
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