RS(255,223)译码器的设计与FPGA实现

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RS码是一种多进制分组循环码,检错和纠错能力强,尤其适合纠正突发错误,在通信系统中有着广泛的应用.本文所研究的RS(255,223)译码器采用修正的Euclid译码算法(MEA),介绍了一种基于FPGA的RS译码器的设计和硬件电路实现方案.按照自顶向下的设计流程,划分模块,详细论述了各子模块的设计过程.
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