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用SystemVerilog验证赛灵思FPGA
用SystemVerilog验证赛灵思FPGA
来源 :电子设计应用 | 被引量 : 0次 | 上传用户:weiqier1110
【摘 要】
:
本文介绍了如何用SystemVerilog验证FPGA,从而说明采用现有的验证工具和方法可以提高设计质量,并加快产品上市速度。
【作 者】
:
Stacey Secatch Bryan Ramirez
【机 构】
:
赛灵思公司资深设计工程师
【出 处】
:
电子设计应用
【发表日期】
:
2009年4期
【关键词】
:
SystemVerilog语言
FPGA
可编程逻辑器件
设计
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本文介绍了如何用SystemVerilog验证FPGA,从而说明采用现有的验证工具和方法可以提高设计质量,并加快产品上市速度。
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