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为满足SoC中JPEG静止图像实时解压缩要求，在完成JPEG解码器C语言建模的基础上，采用自顶向下的设计方法，完成了JPEG Baseline解码器设计，并在FPGA开发板上验证了设计结果。该设计与ACTEL、412I等公司的IP核相比具有相近的解压缩速度，能满足实时解码要求。
基于FPGA的JPEG解码器设计与实现
【摘 要】
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为满足SoC中JPEG静止图像实时解压缩要求，在完成JPEG解码器C语言建模的基础上，采用自顶向下的设计方法，完成了JPEG Baseline解码器设计，并在FPGA开发板上验证了设计结果。该设计
【机 构】
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厦门大学电子工程系
【出 处】
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电子技术应用
【发表日期】
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2008年2期
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