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文章以TSMC’0．35μm，三层金属CMOS工艺为基础，对FPGA互连资源中布线开关和互连线段进行了具体分析。研究表明，布线开关中同时混合使用传输门和三态缓冲器以及采用不同逻辑长度的互连线段组合时将会产生较好的面积-延时值。
FPGA的布线开关和互连线段的优化设计
【摘 要】
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文章以TSMC’0．35μm，三层金属CMOS工艺为基础，对FPGA互连资源中布线开关和互连线段进行了具体分析。研究表明，布线开关中同时混合使用传输门和三态缓冲器以及采用不同逻辑长度的
【机 构】
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江南大学信息工程学院
【出 处】
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电子与封装
【发表日期】
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2007年8期
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