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本文阐述了AHB总线和USB总线的数据传输规范．给出了USB CORE与AHB总线连接的结构框图．提出模块的设计思路并用硬件描述语言Verilog HDL实现了模块的编码及功能仿真。
USB CORE与AHB总线接口功能模块的硬件设计
【摘 要】
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本文阐述了AHB总线和USB总线的数据传输规范．给出了USB CORE与AHB总线连接的结构框图．提出模块的设计思路并用硬件描述语言Verilog HDL实现了模块的编码及功能仿真。
【机 构】
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北京工业大学电子信息与控制工程学院
【出 处】
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仪器仪表用户
【发表日期】
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2006年1期
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