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以一个8位的RISC体系的CPU核为例,介绍了如何将IC设计中的IPCore和FPGA两项技术结合起来,并给出了IP核模块的验证与测试的方法。
RISC结构的IP核验证与测试
【摘 要】
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以一个8位的RISC体系的CPU核为例,介绍了如何将IC设计中的IPCore和FPGA两项技术结合起来,并给出了IP核模块的验证与测试的方法。
【机 构】
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中国科技大学物理系微电子教研室
【出 处】
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半导体技术
【发表日期】
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2003年11期
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