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期刊论文
一种基于非并行BIT的测试性模型
一种基于非并行BIT的测试性模型
来源 :微电子学与计算机 | 被引量 : 0次 | 上传用户:wayl1s1s
【摘 要】
:
通过条件测试解决了在LRU间增加非并行BIT不满足信息流模型测试的一般定义的问题,同时解决了信息流反馈的问题,提高了故障隔离率.提出了基于信息流模型的集中一分布式BIT体系结
【作 者】
:
王栋
陈圣俭
张伟伟
陈健
【机 构】
:
装甲兵工程学院控制工程系,中国航天员科研训练中心,海军装备论证研究院
【出 处】
:
微电子学与计算机
【发表日期】
:
2008年6期
【关键词】
:
机内测试
故障诊断
测试性设计
信息流模型
built in test(BIT)
fault diagnosis
design for testabilit
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通过条件测试解决了在LRU间增加非并行BIT不满足信息流模型测试的一般定义的问题,同时解决了信息流反馈的问题,提高了故障隔离率.提出了基于信息流模型的集中一分布式BIT体系结构,建立了基于该体系结构的系统级BIT测试模型.通过对BIT测试模型的改进,建立了边界扫描测试模型.
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