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QoS中堆排序的脉动阵列结构在FPGA上的实现
QoS中堆排序的脉动阵列结构在FPGA上的实现
来源 :科学技术与工程 | 被引量 : 0次 | 上传用户:yuye1580772
【摘 要】
:
提出了一种用于实现堆排序的串行输入输出的脉动阵列结构,在FPGA上实现了基于该阵列结构的具有QoS保证的核心交换模块。对FPGA中运算部件的微结构进行了分析。实验结果表明,与
【作 者】
:
吴彦宏
陈相宁
【机 构】
:
南京大学电子科学与工程系
【出 处】
:
科学技术与工程
【发表日期】
:
2008年19期
【关键词】
:
脉动阵列
堆排序
QOS
FPGA
VERILOG
HDL语言
systolic array architecture heap sort quality of
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提出了一种用于实现堆排序的串行输入输出的脉动阵列结构,在FPGA上实现了基于该阵列结构的具有QoS保证的核心交换模块。对FPGA中运算部件的微结构进行了分析。实验结果表明,与软件实现相比用FPGA实现堆排序算法能够极大地提高运行速率和优化时序,适用于优秀QoS机制的硬件现实。
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