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描述了一种使用CPLD解决秒脉冲接收、双端口RAM地址译码和CPCI局部总线通信的硬件设计方案,并给出了CPCI总线接口芯片的寄存器配置。
具有秒脉冲接收功能的数据通讯模块设计
【摘 要】
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描述了一种使用CPLD解决秒脉冲接收、双端口RAM地址译码和CPCI局部总线通信的硬件设计方案,并给出了CPCI总线接口芯片的寄存器配置。
【机 构】
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武汉数字工程研究所
【出 处】
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计算机与数字工程
【发表日期】
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2011年5期
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