【摘 要】
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近年来，使用多核SoC代替传统的单处理器系统，在提高系统并行性方面显示出了巨大的优势。本文在已有层次化总线结构MPSoC的基础上，研究多核SoC原型芯片可扩展性设计问题。在RTL级
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近年来，使用多核SoC代替传统的单处理器系统，在提高系统并行性方面显示出了巨大的优势。本文在已有层次化总线结构MPSoC的基础上，研究多核SoC原型芯片可扩展性设计问题。在RTL级设计了上述平台，并用FPGA进行原型验证，以流水矩阵乘法为例研究其在不同工作负载下的加速比变化。实验结果表明，在6个处理器的情形下，循环次数为6次时加速比仅为4．10；随着循环次数增多，加速比可达5．48。研究表明多核层次化总线原型芯片的性能提升百分比以及面积增加百分比与处理器数目成正比。可以通过增加处理器的数目来提升MPSoC
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