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阐述了直接数字频率合成器(DDS)的原理与设计,利用Verilog HDL硬件描述语言实现了DDS功能,在Modelsi m中完成了仿真,并最终经过了FPGA的验证。
基于Verilog HDL的DDS设计
【摘 要】
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阐述了直接数字频率合成器(DDS)的原理与设计,利用Verilog HDL硬件描述语言实现了DDS功能,在Modelsi m中完成了仿真,并最终经过了FPGA的验证。
【机 构】
：
武汉理工大学自动化学院
【出 处】
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长江大学学报(自科版)理工卷
【发表日期】
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2007年04期
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