用于零延迟缓冲器的PLL设计

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【摘要】

：

本文设计了一款用于零延迟时钟缓冲器的PLL，采用一种结构简单并且实现低失配的电荷泵，详细阐述了对噪声有很强抑制作用的一种差分结构的压控振荡器，采用CSMC0．5μmN阱CMOS工艺，在3

【作者】

：

夏志茹薛忠杰

【机构】

：

江南大学信息工程学院,中国电子科技集团公司第58研究所

【出处】

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微计算机信息

【发表日期】

：

2009年26期

【关键词】

：

锁相环电荷泵压控振荡器锁定时间 PLL charge pump VCO locking time

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本文设计了一款用于零延迟时钟缓冲器的PLL，采用一种结构简单并且实现低失配的电荷泵，详细阐述了对噪声有很强抑制作用的一种差分结构的压控振荡器，采用CSMC0．5μmN阱CMOS工艺，在3．3V电源电压下，该PLL的工作频率范围为10MHz-140MHz，罔对同抖动为45ps@50MHz，功耗为4．8mW，芯珐面积为1．2μm×1．7μm.

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