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首先介绍VERILOG语言，讲述使用VERILOG设计硬件的优点以及VERILOG的设计流程，然后简述秒表计时器的功能及接口，最后使用VERILOG语言设计对秒表模块进行设计并用modelsim进行仿真。
秒表计时器的VERILOG实现
【摘 要】
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首先介绍VERILOG语言，讲述使用VERILOG设计硬件的优点以及VERILOG的设计流程，然后简述秒表计时器的功能及接口，最后使用VERILOG语言设计对秒表模块进行设计并用modelsim进行仿真
【机 构】
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重庆邮电大学
【出 处】
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黑龙江科技信息
【发表日期】
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2008年1期
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