基于LVDS的高速数据交换引擎IP核设计

来源 :微电子学与计算机 | 被引量 : 0次 | 上传用户：pocohao

【摘要】

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设计了一种基于LVDS的高速数据交换引擎IP核,并详细阐述了在FPGA上的实现原理和关键设计.该IP核能广泛适用于低速、高速FPGA中,测试结果表明,IP核的逻辑功能正确,可适应从spa

【作者】

：

闫博曹辉杨靓周泉

【机构】

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西安微电子技术研究所

【出处】

：

微电子学与计算机

【发表日期】

：

2014年8期

【关键词】

：

现场可编程门阵列串行解串同步处理低压差分信号双倍数据速率 FPGASerDesSynchronizationLVDSDDR

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设计了一种基于LVDS的高速数据交换引擎IP核,并详细阐述了在FPGA上的实现原理和关键设计.该IP核能广泛适用于低速、高速FPGA中,测试结果表明,IP核的逻辑功能正确,可适应从spartan3A器件上时钟频率150MHz,300Mb/s数据传输速率(1位模式,4位模式下达到1.2Gb/s),到Virtex6器件上时钟频率500MHz,1Gb/s数据传输速率(1位模式,4位模式下达到4Gb/s).

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