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介绍了使用VHDL语言设计一个8位三态锁存器,给出了功能仿真波形,说明了实现电子电路的自动化设计(EDA)过程.
8位三态锁存器的VHDL程序设计
【摘 要】
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介绍了使用VHDL语言设计一个8位三态锁存器,给出了功能仿真波形,说明了实现电子电路的自动化设计(EDA)过程.
【机 构】
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华中理工大学汉口分校
【出 处】
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信息技术
【发表日期】
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2001年9期
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