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介绍了一种以FPGA作为核心器件,以Verilog作为描述语言的数字频率计测量方法,并通过Quartus Ⅱ软件对编写的代码进行了时序仿真,验证了设计的正确性。
基于FPGA数字频率计的设计
【摘 要】
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介绍了一种以FPGA作为核心器件,以Verilog作为描述语言的数字频率计测量方法,并通过Quartus Ⅱ软件对编写的代码进行了时序仿真,验证了设计的正确性。
【机 构】
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渭南师范学院数理学院;
【出 处】
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现代经济信息
【发表日期】
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2016年22期
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