【摘 要】
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针对编码精度固定导致不同样本压缩率不稳定的问题,提出了一种基于5/3提升小波的编码精度自调节的心电(ECG)信号压缩专用集成电路(ASIC)。根据ECG信号的抖动程度动态自调节编
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针对编码精度固定导致不同样本压缩率不稳定的问题,提出了一种基于5/3提升小波的编码精度自调节的心电(ECG)信号压缩专用集成电路(ASIC)。根据ECG信号的抖动程度动态自调节编码精度,将压缩率稳定在较高水平。通过逆向扫描避免了嵌入式零树小波(EZW)编码中的递归运算,降低电路复杂度。设计的电路在压缩率为23. 91情况下仅有3. 86%失真度。在40 nm CMOS工艺下,ASIC实现仅有9 885个等效门,在1. 1V的供电电压下,功耗仅为7. 11μW。
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