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本文阐述了一个128×32bits的三端口寄存器堆的高速低功耗设计,说明了分块结构的确定、存储单元的改进以及其他部分电路的设计.在TSMC 0.25μm CMOS工艺下实现版图的设计,并在2.5V工作电压下进行了后仿真.该寄存器堆的工作频率最高可达500MHz,功耗约为55mw.
一种高速低功耗的三端口寄存器堆的设计
【摘 要】
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本文阐述了一个128×32bits的三端口寄存器堆的高速低功耗设计,说明了分块结构的确定、存储单元的改进以及其他部分电路的设计.在TSMC 0.25μm CMOS工艺下实现版图的设计
【机 构】
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哈尔滨工业大学微电子中心
【出 处】
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微处理机
【发表日期】
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2003年4期
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