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期刊论文
高速数字设计中的信号完整性问题
高速数字设计中的信号完整性问题
来源 :舰船电子对抗 | 被引量 : 0次 | 上传用户:tyxtry88
【摘 要】
:
随着集成电路输出开关速度的提高以及PCB板密度的增加,信号完整性已经成为高速数字设计必须关心的问题之一.如何在设计过程中充分考虑到信号完整性的因素,并采取有效的控制措
【作 者】
:
夏军成
【机 构】
:
船舶重工集团公司723所
【出 处】
:
舰船电子对抗
【发表日期】
:
2003年4期
【关键词】
:
集成电路
输出开关速度
信号完整性
高速数字设计
SPICE模型
IBIS模型
解决方法
Verilog-AMS模型
VHDL-AMS模型
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随着集成电路输出开关速度的提高以及PCB板密度的增加,信号完整性已经成为高速数字设计必须关心的问题之一.如何在设计过程中充分考虑到信号完整性的因素,并采取有效的控制措施,已经成为当今高速设计业界的一个热门课题.
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