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研究JPEG图像的Huffman解码器在集成电路上的实现问题，以范式Huffman编码为研究对象，在研究范式Huffman编码特点及快速算法的基础上设计出高速Huffman解码电路。此解码电路已经在Altera的FPGA上通过测试，系统能稳定运行在140MHz，输出数据平均达到约1．2Gb／s的带宽。