基于RSIC的简易CPU的设计与实现

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随着科技的进步,电子产品硬件发生着巨大的变化,计算机的核心部件中央处理器CPU更是日新月异.本文采用EDA技术,以verilog HDL为开发语言,在XILINX和modelsim的开发环境上,设计和仿真基于RISC架构的简易8位CPU.在这里,将CPU划分为八个模块:时钟发生器,指令寄存器,程序计数器,累加器,加法器,控制器,存储器和译码器组成.采用自顶向下的方法进行设计,最后对系统进行了编译和仿真.
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