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给出了一种用于H.264全搜索可变块匹配算法的运动估计电路的改进结构,并完成了VLSI设计的仿真验证。在传统脉动阵列,全流水线设计的基础上,通过引入片内Cache,增加输入端口,大大减少传统方式下对延迟寄存器的依赖,进一步降低了功耗。仿真实验以CIF图像（352×288）为例进行结构验证,证明设计能实时处理H.264格式标准下的视频序列。