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通过对传统串行CRC（循环冗余校验）电路中各移位寄存器状态的观察与分析，推导出并行算法的逻辑关系式，使用Verilog-hdl语言实现了并行算法并给出了仿真结果，仿真结果表明与串行算法相比并行算法提高了校验速率。
循环冗余校验码并行算法的研究与实现
【摘 要】
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通过对传统串行CRC（循环冗余校验）电路中各移位寄存器状态的观察与分析，推导出并行算法的逻辑关系式，使用Verilog-hdl语言实现了并行算法并给出了仿真结果，仿真结果表明与串行算法
【机 构】
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华中科技大学工程计算与仿真研究所
【出 处】
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计算机与数字工程
【发表日期】
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2006年9期
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