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设计了一款整数型锁相环．从系统到具体电路对整个锁相环进行了详细的分析和仿真．电路采用SMIC0．18μmCMOS射频工艺设计，面积为1．1mm×1．1mm，整个锁相环在1．8V电源电压下的功耗为36mw，仿真结果显示锁相环的相位噪声在-111dBc／Hz@1MHz，参考杂散为-76．4dBc．
3．5GHz锁相环的设计
【摘 要】
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设计了一款整数型锁相环．从系统到具体电路对整个锁相环进行了详细的分析和仿真．电路采用SMIC0．18μmCMOS射频工艺设计，面积为1．1mm×1．1mm，整个锁相环在1．8V电源电压下的功耗为3
【机 构】
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中国科学院微电子研究所
【出 处】
：
微电子学与计算机
【发表日期】
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2009年6期
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