32位高性能嵌入式CPU中Load Aligner模块的设计与实现

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【摘要】

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在CPU中,L0ad Aligner模块是DCACHE和数据通道之间的接口.从DCACHE中取出的数据只有通过L0ad Aligner模块重新排序,才能进入CPU的数据通道.本文讨论了该CPU中Load Aligner模

【作者】

：

张书王颖林正浩

【机构】

：

同济大学微电子中心

【出处】

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今日电子

【发表日期】

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2005年1期

【关键词】

：

嵌入式CPU 数据通道模块接口逻辑设计排序电路设计高性能

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在CPU中,L0ad Aligner模块是DCACHE和数据通道之间的接口.从DCACHE中取出的数据只有通过L0ad Aligner模块重新排序,才能进入CPU的数据通道.本文讨论了该CPU中Load Aligner模块的设计与实现,其中主要是数据通道部分的逻辑设计和电路设计,并给出了相关结果.

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