基于EDA技术的高速FIFO设计

来源 :现代电子技术 | 被引量 : 0次 | 上传用户：fondfood

【摘要】

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利用Lattice公司的在系统可编程逻辑器件ispLSI6192芯片构造4个双向、独立的128×9位FIFO高速数据存储栈区(FIFO),并对芯片可编程逻辑编程建立快速地址加1计数器以及FIFO

【作者】

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邵明杰

【机构】

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煤碳科学研究总院抚顺分院

【出处】

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现代电子技术

【发表日期】

：

2005年22期

【关键词】

：

高速数据栈区地址自动加1计数器高速寄存器 FIFO high speed data memory counter of high speed addres

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利用Lattice公司的在系统可编程逻辑器件ispLSI6192芯片构造4个双向、独立的128×9位FIFO高速数据存储栈区(FIFO),并对芯片可编程逻辑编程建立快速地址加1计数器以及FIFO控制逻辑,控制逻辑分别对4个FIFO栈区进行读/写控制;实现将系统的高速数据栈区及其控制逻辑功能在同一个芯片上实现,从而提高计算机数据通信的速度、效率以及提高系统的集成度和降低系统的故障率.

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