【摘 要】
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本文是基于一种最新的精简指令集RISC-V来设计的一种五级流水线的微处理器,通过对流水线的取指、译码、执行、访存和回写级进行了逻辑和功能的设计,并对相应的指令功能和实现
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本文是基于一种最新的精简指令集RISC-V来设计的一种五级流水线的微处理器,通过对流水线的取指、译码、执行、访存和回写级进行了逻辑和功能的设计,并对相应的指令功能和实现进行仿真验证,最后基于Wishbone总线结构设计了微处理器的外围设备以构成具有实用化功能的微控制器,其中包括GPIO、UART控制器,并将综合仿真后的微控制器和测试程序下载进入FPGA进行整体功能验证.
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