【摘 要】
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提出了一种内置于SAR ADC的低功耗DAC,采用不同缩放类型分段组合的方式,明显减小了芯片占用面积,降低了功耗.基于华润上华公司的0.35 μm CMOS工艺,利用CadenceSpectre仿真工
【机 构】
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武汉科技大学信息科学与工程学院,武汉,430081
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提出了一种内置于SAR ADC的低功耗DAC,采用不同缩放类型分段组合的方式,明显减小了芯片占用面积,降低了功耗.基于华润上华公司的0.35 μm CMOS工艺,利用CadenceSpectre仿真工具对电路进行分析,结果显示该DAC整体电路的功耗为0.93 mW,最大积分非线性(INL)为-0.74 LSB,最大微分非线性(DNL)为-0.48 LSB,优值(FOM)为3.81,版图的面积为0.086 mm2,很好地满足了低功耗和小面积的要求.
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