【摘 要】
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提出了一种电荷泵锁相环电路实现的适用于2.5 Gbps千兆以太网发接器要求的高速时钟倍频器的设计方法.为了获得高速时钟,设计中采用了双环路的VCO结构,并且运用动态D触发器来
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提出了一种电荷泵锁相环电路实现的适用于2.5 Gbps千兆以太网发接器要求的高速时钟倍频器的设计方法.为了获得高速时钟,设计中采用了双环路的VCO结构,并且运用动态D触发器来实现高速分频器.同时为了使得PLL性能更加稳定,对电路作了进一步改进:在VCO的延迟单元中加了温度补偿部分,又采用箝位技术消除电荷泵中电荷重新分配引入的影响.运用UMC 0.18 μm,1.8 V CMOS工艺模型,在Cadence的环境下用spectreS仿真器模拟;结果表明设计的时钟倍频电路对于不同的PVT(P表示工艺变化引起的模
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赵望秦教授1953年12月31日生,西安临潼人,现于陕西师范大学文学院从事古代文学与古典文献学的教学与研究工作。1982年6月,他毕业于陕西师范大学中文系,并师从古代文史学权威
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