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针对一类乘同余运算，提出了一种快速算法。采用1个32位乘法、2个32位加法、少量移位操作和1个最高位分离操作方法，避免了连续减法和除法运算。采用硬件语言设计了快速算法。在此算法的基础上，设计了基于FPGA的伪随机序列发生器。
一种乘同余伪随机序列快速实现的FPGA设计
【摘 要】
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针对一类乘同余运算，提出了一种快速算法。采用1个32位乘法、2个32位加法、少量移位操作和1个最高位分离操作方法，避免了连续减法和除法运算。采用硬件语言设计了快速算法。在
【机 构】
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淮南师范学院计算机与信息工程系
【出 处】
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电子技术应用
【发表日期】
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2010年7期
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