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本文报导一个用于48M Hz时钟产生器的锁相环.该PLL采用0.25μm n-well CMOS工艺,在2.5V供电电压下,其静态电流为1.44mA.有效版图面积为600μm·335μm.
用于48MHz时钟产生器CMOS PLL
【摘 要】
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本文报导一个用于48M Hz时钟产生器的锁相环.该PLL采用0.25μm n-well CMOS工艺,在2.5V供电电压下,其静态电流为1.44mA.有效版图面积为600μm·335μm.
【机 构】
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南开大学
【出 处】
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南开大学学报(自然科学版)
【发表日期】
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2004年3期
【基金项目】
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天津市科技攻关项目
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