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本文介绍了同步调制解调器中解调器的设计，重点描述了时钟和数据的提取，以及核心单元全数字锁相环（ADPLL）电路设计。经过测试和用户使用表明，电路的功能正确，性能满足系统要求。
同步MODEM中接收时钟和数据的提取及ADPLL设计
【摘 要】
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本文介绍了同步调制解调器中解调器的设计，重点描述了时钟和数据的提取，以及核心单元全数字锁相环（ADPLL）电路设计。经过测试和用户使用表明，电路的功能正确，性能满足系统要求。
【机 构】
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中国兵器工业第214研究所
【出 处】
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集成电路通讯
【发表日期】
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2006年2期
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