带有饱和处理功能的并行乘加单元设计

来源 :电子设计应用 | 被引量 : 0次 | 上传用户：yan19891989

【摘要】

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本文介绍了一种48bit+24bit×24bit带饱和处理的MAC单元设计.在乘法器的设计中,采用改进的booth算法来减少部分积的数目,用由压缩单元组成的Wallace tree将产生的部分积

【作者】

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贾俊波杨军吴艳陆生礼

【机构】

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东南大学国家专用集成电路工程中心

【出处】

：

电子设计应用

【发表日期】

：

2004年11期

【关键词】

：

部分积处理功能并行元组乘法器 BOOTH算法 MAC 单元设计压缩阵列

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本文介绍了一种48bit+24bit×24bit带饱和处理的MAC单元设计.在乘法器的设计中,采用改进的booth算法来减少部分积的数目,用由压缩单元组成的Wallace tree将产生的部分积相加,并将被加数作为乘法器的一个部分积参与到Wallace tree阵列中来完成乘加运算,同时增加了饱和检测和饱和值运算逻辑来实现饱和处理.

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